ADSP-BF522/ADSP-BF523/ADSP-BF524/ADSP-BF525/ADSP-BF526/ADSP-BF527
Asynchronous Memory Write Cycle Timing
Table 35. Asynchronous Memory Write Cycle Timing
ADSP-BF522/ADSP-BF524/
ADSP-BF526
ADSP-BF523/ADSP-BF525/
ADSP-BF527
V DDMEM
1.8 V Nominal
V DDMEM
2.5 V or 3.3 V
Nominal
V DDMEM
1.8 V Nominal
V DDMEM
2.5 V or 3.3 V
Nominal
Parameter
Min
Max
Min
Max
Min
Max
Min
Max
Unit
Timing Requirements
t SARDY
t HARDY
ARDY Setup Before CLKOUT
ARDY Hold After CLKOUT
4.0
0.2
4.0
0.2
4.0
0.2
4.0
0.2
ns
ns
Switching Characteristic s
Output Hold After CLKOUT
t DDAT
t ENDAT
t DO
t HO
DATA15 –0 Disable After CLKOUT
DATA15 –0 Enable After CLKOUT
Output Delay After CLKOUT 1
0.0
0.8
6.0
6.0
0.0
0.8
6.0
6.0
0.0
0.8
6.0
6.0
0.0
0.8
6.0
6.0
ns
ns
ns
ns
1
Output balls include AMS3 –0, ABE1 –0, ADDR19 –1, DATA15 –0, AWE.
CLKOUT
AMSx
ABE1–0
ADDR19–1
SETUP
2 CYCLES
t DO
t DO
PROGRAMMED
WRITE
ACCESS
2 CYCLES
ACCESS
EXTEND HOLD
1 CYCLE 1 CYCLE
t HO
t HO
AWE
t SARDY
t HARDY
ARDY
t ENDAT
t SARDY
t HARDY
t DDAT
DATA 15–0
Figure 12. Asynchronous Memory Write Cycle Timing
Rev. D
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